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SoC需要验证

目前芯片一次投片成功率(first silicon)只有35%左右,主要原因就是验证不够充分。SoC设计的验证需  (本文共3页) 阅读全文>>

解放军信息工程大学
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SoC/IP验证平台的研究与实现

IP复用技术在加快SoC开发进程的同时,也给SoC/IP的功能验证提出了更大的挑战。针对SoC/IP验证的复杂性,如何提高验证质量和效率成为SoC/IP开发过程中需要解决的重要现实问题。本文以自主研发的某款SoC芯片的功能验证为背景,在对SoC/IP的验证特征和验证需求进行分析的基础上,结合动态仿真技术和验证平台设计技术,以快速搭建一种可以全面提高验证质量和效率的SoC/IP验证平台为目标,对SoC/IP验证平台结构和设计实现进行了重点研究。本文提出了一种面向验证过程的层次化验证方法,制定了相应的层次化验证方案,对验证平台结构和实现、验证激励生成、验证文件管理、验证步骤设计等五个验证环节进行优化和改进,并重点设计了一种基于总线的层次化SoC/IP验证平台结构,实现验证平台的横向和纵向模块化划分,进而完成了事务级测试场景和可重用验证组件等核心模块的设计。本文完成了NFC控制器的设计,实现片上处理器对NandFlash的灵活控制。根...  (本文共73页) 本文目录 | 阅读全文>>

合肥工业大学
合肥工业大学

基于UVM对SOC关键外设的验证

文中开篇讲述了验证工作在芯片行业的重要地位,以及现今验证与设计之间巨大的技术鸿沟。验证技术的提升需求迫切,以及对于SOC片上系统的研究现状进行了总结。接着主要阐述本文采用的UVM验证方法学的平台结构,激励构造和验证手段,在文中通过三个例子完成验证平台的搭建,通过SOC片上三个外设的时序特点和信号特性构造出一个可重用自动化的验证平台~([1])。现今社会,芯片产业已经成为影响国计民生的重要产业,成为大国之间博弈的的关键因素。集成电路高速发展意味着电路规模大大增加和电路逻辑更加丰富,电路规模的增加也就对验证的要求更加高。对于一个超大的SOC片上系统的验证,想要保证设计的正确性必须要针对传统的验证方法进行改进。验证的效率和验证的完备性已经是如今芯片设计生产中的最关键的一步。验证工作主要有以下三个方面:第一,针对耗材打印机SOC片上系统搭建一个可重用的高效率UVM验证平台;第二,通过待验证模块的特点进行激励的构造,其中包括定向测试和随机...  (本文共69页) 本文目录 | 阅读全文>>

山东大学
山东大学

基于FPGA的系统芯片(SoC)原型验证研究与实现

随着EDA(Electronic Design Automatic)技术和半导体制造工艺的不断发展,系统芯片SoC(System on a Chip)的功能越来越强,器件结构越来越复杂。根据摩尔定律,验证的复杂度是与芯片面积的平方成正比的,随着芯片单位面积上容量每18个月增长一倍,验证的复杂度也会每6-9个月翻一番。验证工作是目前SoC设计过程中最耗时费力的一项工作,它可以占到整个设计工作量的50-80%,是当今SoC设计的瓶颈。因此,找到一种方便、灵活、高效的验证方法,尽快缩短产品的开发面市时间,以达到适应市场需求之目的,已成为关注的焦点。根据SoC的功能和结构特性,除需硬件模块之外,还需要大量的固件和软件,如配置操作系统、通讯协议以及应用程序等。由于SoC硬件模块数目众多、内嵌软件复杂,传统的基于逻辑模拟的验证方式已不再可行,特别是其在软硬协同验证时,模拟时间之长令人难以忍受。为了缩短SoC验证时间,基于FPGA的快速系统原...  (本文共71页) 本文目录 | 阅读全文>>

电子科技大学
电子科技大学

统一验证方法的实现

随着半导体工艺和电子设计自动化技术的不断发展,SoC芯片集成度越来越高,芯片的功能越来越复杂,而SoC开发时间越来越短,导致SoC设计生产率无法满足实际产品的需求。因此,SoC设计中面临的复杂的IP模块、嵌入式软件、不断增长的晶体管数量、系统验证不完备等等,都成为传统方法日益增重的负担。面对SoC设计的这些挑战,必须在IC设计方法上有重大变革。目前的SoC设计中,验证工作需要投入的资源已占整个设计资源的60%~80%,甚至超过85%,其效率越来越成为制约设计效率的瓶颈。因此,如何提高SoC验证效率已经成为SoC设计方法学研究的关键领域之一。其中,仿真验证作为传统的验证方法,目前仍然是主流的验证技术。因此,仿真验证效率的提高能极大地缩短整个设计流程。传统的仿真验证方法一般是针对设计流程中特定抽象层次的模型来建立验证环境。这样的验证环境存在以下几个问题:不支持验证环境在多级模型中的复用;不同抽象层次的验证环境存在一致性验证问题;验证...  (本文共85页) 本文目录 | 阅读全文>>

中国科学技术大学
中国科学技术大学

对一种SOC总线系统的验证

SOC(system on a chip)设计的显著特点为IP的可重用性,从而保证了较短的开发时间,由于底层已验证模块的大量使用,各模块的粘合,即总线系统的设计问题显得越来越突出。随着集成电路规模的不断扩大,设计验证成为集成电路设计中最重要的任务。不同的验证方法不断出现,包括随机测试生成,基于覆盖率驱动的测试方法等等,但都有其缺点。本文对于SOC总线系统的验证,提出一种基于模拟仿真和覆盖率分析的方法。前期使用带约束的随机测试向量输入待验证系统进行模拟仿真,在达到一定条件后停止仿真。然后分析结果:如果仿真时间已经足够长但是覆盖率并不高,则改进测试向量的产生方法,调整其约束,重新产生测试向量进行模拟仿真;如果覆盖率已经达到要求,则分析当前的覆盖率情况,然后手工生成测试向量来验证尚未验证到的部分。然后本文对一款SOC的总线系统进行了验证。首先通过模块划分的办法,对SOC总线的各个模块分别进行验证完毕后再进行整个系统的验证,从而减少验证...  (本文共95页) 本文目录 | 阅读全文>>